概要

Neoverse CSS N2で、効率的かつ高性能なインフラストラクチャシリコンをより迅速に提供

AI Summary

Neoverse CSS N2は、電力効率のよい検証済みのArmコンピューティングサブシステムです。パートナーがコンセプトから量産対応のクラウドおよびインフラストラクチャシリコンへと迅速に移行する支援をします。Neoverse N2コアとArmシステムIPを事前統合済みのプラットフォームに組み合わせ、優れたワット当たりのパフォーマンスを実現しながら、設計リスクとエンジニアリングの労力を削減します。

Neoverse CSS N2を選ぶ理由

事前統合済み・完全検証済みの設計

事前統合済み・完全検証済みの設計

Neoverse CSS N2は、CPU、メモリー、I/Oを単一のアーキテクチャとして提供します。

次世代のインフラストラクチャに対応

次世代のインフラストラクチャに対応

実証済みのすぐに展開可能な設計で、最新のArmv9、DDR5、PCIe Gen5、CXLテクノロジーを導入します。

世界トップクラスのワット当たりのパフォーマンスを実現

世界トップクラスのワット当たりのパフォーマンスを実現

電力、サステナビリティ、総保有コスト削減の目標を達成します。

メリット

シリコンまでの時間を短縮

  • A faster path to first silicon:

    Accelerate from concept to silicon with a pre-integrated, performance-validated compute subsystem.

  • Higher performance with better energy efficiency:

    Achieve up to 40% IPC uplift over Neoverse N1, improving performance per watt..

  • Reduced integration risk and engineering effort:

    Minimize integration challenges with a validated compute foundation, saving engineering time.

  • Easier adoption of advanced technologies:

    Implement Armv9, DDR5/LPDDR5, PCIe Gen5, and CXL with less integration overhead.

benefits
Neoverse CSS N2の解析

Arm Neoverse CSS N2の構成要素

Arm Neoverse CSS N2は、パートナーにより差別化された、カスタマイズ済みのシリコンを記録的な速さで市場に投入する新しいアプローチです。

パフォーマンスを最適化したコンピューティングサブシステム

パフォーマンスを最適化したコンピューティングサブシステム

Neoverse N2を中心に構築され、クラウド、エッジ、ネットワーキングのワークロードに優れたハイパフォーマンスを提供します。

統合された高帯域幅の接続

統合された高帯域幅の接続

DDR5/LPDDR5メモリーとPCIe Gen5/CXLのサポートを組み合わせ、高速でスケーラブルなシステム設計を実現します。

検証済みのマルチコアスケーラビリティ

検証済みのマルチコアスケーラビリティ

パフォーマンスが実証された検証済みサブシステム構成で、最大64個のNeoverse N2コアを提供します。

量産シリコンへの近道

量産シリコンへの近道

開発の労力を軽減し、市場投入までの時間を短縮できる、事前統合済みの設計基盤を提供します。

Arm Neoverse CSS N2

ユースケース

Neoverse CSS N2が実際のインフラストラクチャを支えている場所

Cloud computing

Cloud customers are experiencing up to 40% improved price performance over comparable traditional architecture-based instances on a broad range of workloads.

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Cloud computing

Cloud and data center infrastructure

Arm-powered cloud and data center systems deliver the performance, efficiency, and scalability needed to run today’s general-purpose workloads and tomorrow’s AI-driven compute demands. Providers can meet growing performance requirements without compromising TCO or sustainability targets.

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Cloud and datacenter infrastructure
Cloud computing
Arm AGI CPU logo

製品詳細解説

個々の CPU コアからラックスケールの経済性、サーバープロバイダーに至るまで、Arm AGI CPU の技術的詳細をご覧ください。

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サクセスストーリー

Arm Neoverse CSS N2を活用したサクセスストーリー

Abstract digital circuit with glowing blue pathways. Optimum price-performance with Microsoft Cobalt

Microsoft Cobaltによる最適な価格性能比

詳細はこちら

Partner story: Novatek

Novatekと共にデータセンター向けチップレットのイノベーションを推進

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Partner story: ASICLAND

Arm Neoverse CSS N2を使用したASICLANDの設計ソリューション

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エキスパートに相談する

Arm Neoverse CSS N2がどのように一般的なインフラストラクチャに電力を最適化した高効率のコンピューティングを提供する支援をするかを説明します。

お問い合わせ

重要なポイント

  • CSS N2 delivers a verified, performance-validated compute foundation that reduces design cycles from years to months.

  • With up to ~40% IPC uplift over Neoverse N1, CSS N2 delivers high performance per watt across diverse infrastructure workloads spanning cloud, networking, and edge.

  • By providing a pre-integrated compute foundation, CSS N2 reduces integration complexity and late-stage risks, enabling partners to save significant engineering time on the path to first silicon.

  • CSS N2 combines Armv9 cores with DDR5/LPDDR5, PCIe Gen5, and CXL in a validated configuration that lets partners adopt advanced technologies with less integration overhead.

FAQs

FAQ

Arm Neoverse CSS N2とは何ですか?

Neoverse CSS N2は、最大64個のArm Neoverse N2コアをDDR5/LPDDR5メモリーおよびPCIe Gen5/CXL I/Oと統合した、検証済み・パフォーマンス実証済みのコンピューティングサブシステムで、インフラストラクチャクラスのシリコン提供を加速させます。カスタマイズ可能で、電力が最適化された基盤をパートナーに提供します。

CSS N2はシリコン量産までの時間をどのように短縮しますか?

CSS N2は、パフォーマンス目標が実証された事前検証済みの設計にCPUクラスター、メモリー、I/O、システムIPを統合しています。パートナーは、設計の構想から約13か月で動作するシリコンまで進めることができ、推定約80エンジニアリング工数を節約できます。

パフォーマンスの向上はどの程度ですか?

3.0 GHzで256個のNeoverse N2コアを集約したマルチチップ構成で、CSS N2は約1,000の SPECrate®2017_intスコアをターゲットとしており、クラウド規模のワークロードで高いスループットを実現します。実際の結果は実装によって異なります。

どのようなテクノロジーがサポートされていますか?

CSS N2は、DDR5/LPDDR5、PCIe Gen5、CXLなど最先端のメモリーとI/Oを実装し、コヒーレントファブリック、仮想化、スケーラブルなNoC向けに、CMN-700、MMU-700、GIC-700、NI-700などのArmシステムIPと統合するように設計されています。

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