パワーマネジメントキット

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ARM^®パワーマネジメントキット（PMK）の使用により、チップのダイナミック電力とリーク電力を大幅に削減できます。PMKは、多数の電力管理手法を実装するためのさまざまなコンポーネントを含んでおり、主要なEDAベンダによって、最新の低電力設計フローにシームレスに統合されています。

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PMKをお勧めする理由

パフォーマンス

仕様

関連製品

リソース

マルチミリオンゲートSoC設計を正常にビルドし、バッテリ寿命の延長やシステムコストの削減を実現するためには、すべての設計においてダイナミック電力とリーク電力を削減することが不可欠です。

PMKによるダイナミック電力とリーク電力の削減は、ARMフィジカルIPのテストシリコンおよびARMプロセッサの設計に基づくシリコンで実証されています。

ダイナミック電力は、チップ全体またはブロックの動作電圧を下げることで削減できます。それには、オンチップの各電圧アイランドで、レベルシフタを使用する必要があります。
リーク電力は、チップのブロックの電源を遮断することで飛躍的に削減できます。これは、オンチップのパワーゲートで電源（VDD）とグランド(VSS)を切り替えることで実現できます。
チップの一部の電源を遮断する場合、連続要素の状態維持が必要になることがあります。これは、リテンションフリップフロップ、リテンションスキャンフリップフロップ、およびリテンションラッチを使用することで実現できます。

リーク電力の急増

MHz範囲の低周波数コントローラアプリケーションから...
...高性能なGHzアプリケーションまで
PMKコンポーネントは、あらゆる種類の設計に使用できます

スリープモードでリーク電力を最大99%削減します。
スリープモードから数百ナノ秒ですばやく復帰します。
ブロック内に特別なウェルスペースは必要ありません。
- パワーゲートの面積を最小限に抑えることができます。
- パワーゲートおよびレベルシフタの配置要件はありません。
- 実装が簡単です。
標準のフリップフロップとリテンションフリップフロップにパフォーマンスの差はありません。
アップレベルシフタのシフト範囲が広く、特別な回路により確実に電圧をシフトします。
ダウンシフタには、特別な回路はなく、サイズおよびパフォーマンスはAND/NANDゲートと同等です。

非常に大きなセルセットにより、あらゆる種類の設計の実装を最適化します。
- Vtあたり約250セル（チャネル長32/45nm）
- テクノロジの成熟に応じて小さくなるセルセット

機能
- 電源（VDD）を切り替えるパワーゲートのヘッダセルと、グランド（VSS）を切り替えるフッタセル
- 絶縁機能付きまたは絶縁機能なしのアップレベルシフタ、ダウンレベルシフタ、および双方向レベルシフタ
- 専用の絶縁セル
- リテンションフリップフロップ、リテンションスキャンフリップフロップ、およびリテンションラッチ
- 常時オンのバッファ、インバータなどのサポートセル
すべての機能は、複数の駆動強度で実装されます。
UPFとCPFのコンストラクト、省電力バックエンドVerilogモデル、ウェルのモデル化が含まれます。
一部の設計スタイルには、特許が認められています。
リーク電力をさらに削減するために、パワーゲートとリテンションフリップフロップのマルチVtとチャネル長を最適化します。
マルチVdd特性およびオーバードライブ電圧をサポートしています。

ARMパワーマネジメントキットロジックIPは、互換性のあるARMスタンダードセルライブラリとともに使用します。また、設計全体にわたって多様なIPを必要とする複雑なSoC設計にも使用できます。ARMは、パワーマネジメントキットIPに加え、ARMプロセッサ、マルチメディア、システム、フィジカルIPなど、プロセッサからパッドまで、SoCを開発するためのさまざまな互換IPを提供しています。

DesignStartにアクセスして、目的のSoCに適したARM IPソリューションを見つけ、今日から設計を開始してください。

ARMフィジカルIP	ARMプロセッサIP	ARMシステムIP	ARMマルチメディアIP
スタンダードセルライブラリ	Cortex-A9	メモリコントローラ	Mali-400
ECOキット	Cortex-A5	システムコントローラ	Mali-200
組み込みメモリ	Cortex-R4	デバッグ&トレースIP	Mali-VE6
インタフェース	Cortex-M3	ペリフェラル	Mali-VE3

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